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　　Virtuoso Chip Assembly Router培訓(xùn)
   入學(xué)要求

        學(xué)員學(xué)習(xí)本課程應(yīng)具備下列基礎(chǔ)知識：
        ◆ 電路系統(tǒng)的基本概念。
   班級規(guī)模及環(huán)境--熱線:4008699035 手機:15921673576( 微信同號)
       每期人數(shù)限3到5人。
   上課時間和地點
上課地點：【上海】：同濟大學(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院 【北京分部】：北京中山學(xué)院/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領(lǐng)館區(qū)1號（中和大道） 【沈陽分部】：沈陽理工大學(xué)/六宅臻品 【鄭州分部】：鄭州大學(xué)/錦華大廈 【石家莊分部】：河北科技大學(xué)/瑞景大廈 【廣州分部】：廣糧大廈 【西安分部】：協(xié)同大廈
最近開課時間(周末班/連續(xù)班/晚班）：Virtuoso Chip Assembly Router培訓(xùn)：2020年6月15日
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        2、培訓(xùn)結(jié)束后,授課老師留給學(xué)員聯(lián)系方式,保障培訓(xùn)效果,免費提供課后技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費推薦就業(yè)機會。
　　Virtuoso Chip Assembly Router培訓(xùn)
培訓(xùn)方式以講課和實驗穿插進行

課程描述：

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Virtuoso Chip Assembly Router Course Description

This course explores the basic design flow for device-level and chip-level routing with?Virtuoso Chip Assembly Router. You will focus on methods of solving typical problems?while routing a top-level block design.

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The highlights of this class include the following:
  • Learn about available translators for the Virtuoso Chip Assembly Router
  • Find, analyze, and solve typical problems
  • Explore component placement techniques
  • Understand routing techniques (automatic and interactive)
  • Create rules for clearance, timing, and noise
  • Explore power routing capabilities
  • Route device-level designs
  • Route a chip-level design

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Audience

  • DSM Designers
  • Chip Designers
  • The primary audience includes experienced chip assembly users who are interested in improving block and chop assembly routing techniques for their design flows

Prerequisites

Students should already have knowledge of:

  • Virtuoso Layout Editor
  • Virtuoso XL Layout Editor

Students should have practical experience with:

  • UNIX OS

Course Agenda

  • Introduction
  • Preparing and translating data
  • Virtuoso Chip Assembly Router environment
  • Interactive placement
  • Interactive routing
  • Using rules and levels
  • How the autorouter works
  • Creating device-level designs
  • Creating chip-assembly deisgner
 
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.(2024年07月24日)..........................................................

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