曙海教育集團(tuán)
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嵌入式OS--4G手機(jī)操作系統(tǒng)
嵌入式硬件設(shè)計(jì)
Altium Designer Layout高速硬件設(shè)計(jì)
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芯片設(shè)計(jì)/大規(guī)模集成電路VLSI
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      數(shù)字集成電路前端多時(shí)鐘設(shè)計(jì)專題班
   入學(xué)要求

        學(xué)員學(xué)習(xí)本課程應(yīng)具備下列基礎(chǔ)知識(shí):
        ◆ 電路系統(tǒng)的基本概念。

   班級(jí)規(guī)模及環(huán)境--熱線:4008699035 手機(jī):15921673576( 微信同號(hào))
       每期人數(shù)限3到5人。
   上課時(shí)間和地點(diǎn)
上課地點(diǎn):【上海】:同濟(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號(hào)線白銀路站) 【深圳分部】:電影大廈(地鐵一號(hào)線大劇院站)/深圳大學(xué)成教院 【北京分部】:北京中山學(xué)院/福鑫大樓 【南京分部】:金港大廈(和燕路) 【武漢分部】:佳源大廈(高新二路) 【成都分部】:領(lǐng)館區(qū)1號(hào)(中和大道) 【沈陽(yáng)分部】:沈陽(yáng)理工大學(xué)/六宅臻品 【鄭州分部】:鄭州大學(xué)/錦華大廈 【石家莊分部】:河北科技大學(xué)/瑞景大廈 【廣州分部】:廣糧大廈 【西安分部】:協(xié)同大廈
最近開(kāi)課時(shí)間(周末班/連續(xù)班/晚班)
數(shù)字集成電路前端多時(shí)鐘設(shè)計(jì)專題班:2020年3月16日
   實(shí)驗(yàn)設(shè)備
     ☆資深工程師授課

        
        ☆注重質(zhì)量
        ☆邊講邊練

        ☆合格學(xué)員免費(fèi)推薦工作

        ☆合格學(xué)員免費(fèi)頒發(fā)相關(guān)工程師等資格證書(shū),提升您的職業(yè)資質(zhì)

        專注高端培訓(xùn)15年,端海提供的證書(shū)得到本行業(yè)的廣泛認(rèn)可,學(xué)員的能力
        得到大家的認(rèn)同,受到用人單位的廣泛贊譽(yù)。

        ★實(shí)驗(yàn)設(shè)備請(qǐng)點(diǎn)擊這兒查看★
   最新優(yōu)惠
       ◆請(qǐng)咨詢客服。
   質(zhì)量保障

        1、培訓(xùn)過(guò)程中,如有部分內(nèi)容理解不透或消化不好,可免費(fèi)在以后培訓(xùn)班中重聽(tīng);
        2、培訓(xùn)結(jié)束后,授課老師留給學(xué)員聯(lián)系方式,保障培訓(xùn)效果,免費(fèi)提供課后技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會(huì)。

        數(shù)字集成電路前端多時(shí)鐘設(shè)計(jì)專題班

課程說(shuō)明

本次課程講授PLL原理,結(jié)構(gòu),應(yīng)用,各功能模塊以及頂層具體實(shí)現(xiàn)方案。通過(guò)本課程培訓(xùn),學(xué)員可以掌握PLL的設(shè)計(jì)流程,并且能夠按照設(shè)計(jì)指標(biāo)要求,實(shí)現(xiàn)PLL的設(shè)計(jì)與仿真,掌握PLL中關(guān)鍵模塊的設(shè)計(jì)方法以及提高性能的具體方案。

課程提綱:

1. PLL原理功能以及應(yīng)用介紹
2. PLL基礎(chǔ)
(1) PLL線性模型,PD/Loop Filter/VCO/Frequency Divider等各模塊建模分析
(2) 時(shí)鐘抖動(dòng)和相位噪聲
(3) 環(huán)路穩(wěn)定性/帶寬/頻響/瞬態(tài)響應(yīng) 性能分析
3. PLL設(shè)計(jì)
(1)系統(tǒng)級(jí)設(shè)計(jì)
環(huán)路帶寬,系統(tǒng)穩(wěn)定性設(shè)計(jì)
(2)各子模塊設(shè)計(jì)
鑒相器(PFD結(jié)構(gòu),性能分析,deadzone)
電荷泵(Charge-Pump結(jié)構(gòu),電流mismatch,漏電,線性分析)
環(huán)路濾波器(Loop Filter 無(wú)源,有源,二階,三階)
壓控振蕩器(VCO 環(huán)振,LC振蕩器,改善jitter的方法)
分頻器 (單模,雙模,高速)
(3)Fractional-N PLL設(shè)計(jì)
小數(shù)分頻原理,設(shè)計(jì)實(shí)現(xiàn),spur的抑制
4. 設(shè)計(jì)經(jīng)驗(yàn)以及一些先進(jìn)結(jié)構(gòu)
設(shè)計(jì)以及版圖,降低jitter注意事項(xiàng)
DLL,自偏置PLL,multi-curve VCO

講師介紹:

集成電路設(shè)計(jì)專業(yè)博士,從事模擬電路設(shè)計(jì)工作近8年,對(duì)模擬設(shè)計(jì)方面有著深入研究。

招生對(duì)象

l 微電子、電子工程、通信、計(jì)算機(jī)等相關(guān)專業(yè)背景、一年左右工作經(jīng)驗(yàn)的在職工程師;
l 微電子、電子、通信、計(jì)算機(jī)等相關(guān)模擬電路設(shè)計(jì)有項(xiàng)目經(jīng)歷的在讀研究生;

報(bào)名要求

l 具備電子電路、通信原理、半導(dǎo)體物理、微電子等基本知識(shí),對(duì)CMOS模擬集成電路設(shè)計(jì)有基本的理解和掌握。
l 有簡(jiǎn)單或小規(guī)模電路設(shè)計(jì)經(jīng)驗(yàn)。

培訓(xùn)目標(biāo)

掌握PLL基本原理與設(shè)計(jì)參數(shù),能分析和設(shè)計(jì)PLL集成電路,可獨(dú)立完成PLL前端設(shè)計(jì)。

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