FPGA性能設(shè)計(jì)培訓(xùn)

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        2、培訓(xùn)結(jié)束后,授課老師留給學(xué)員聯(lián)系方式,保障培訓(xùn)效果,免費(fèi)提供課后技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會(huì)。

課程對象
對 FPGA 設(shè)計(jì)優(yōu)化感興趣、具備 HDL 中級(jí)知識(shí)和擁有 Xilinx ISE? 軟件工具使用經(jīng)驗(yàn)的 FPGA 設(shè)計(jì)者。

課程概要
1
回顧 FPGA 設(shè)計(jì)基礎(chǔ)
利用 FPGA 資源進(jìn)行設(shè)計(jì)
內(nèi)核生成器（CORE Generator）軟件系統(tǒng)
基本 FPGA 時(shí)鐘資源
Virtex-6 和 Spartan-6 FPGA 時(shí)鐘資源
實(shí)驗(yàn)1：利用 FPGA 資源進(jìn)行設(shè)計(jì)
FPGA 設(shè)計(jì)技術(shù)
綜合技術(shù)
實(shí)驗(yàn)2：綜合技術(shù)
2
實(shí)現(xiàn)時(shí)序收斂
實(shí)驗(yàn)3：回顧全局時(shí)序約束
特定通路時(shí)序約束，第1部分
特定通路時(shí)序約束，第2部分
實(shí)驗(yàn)4：實(shí)現(xiàn)時(shí)序收斂
高級(jí)實(shí)現(xiàn)選項(xiàng)
實(shí)驗(yàn)5：性能設(shè)計(jì)
實(shí)驗(yàn)6：FPGA Editor 演示（可選）
ChipScope Pro 軟件（可選）
實(shí)驗(yàn)7：ChipScope Pro 軟件（可選）