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　　　　　數(shù)字集成電路前端設(shè)計(jì)培訓(xùn)班

課程目標(biāo)

通過本課程的學(xué)習(xí)，使學(xué)員在掌握數(shù)字集成電路設(shè)計(jì)的基本要領(lǐng)，熟悉操作系統(tǒng)和硬件描述語言HDL,熟練使用邏輯綜合仿真工具和仿真工具，并學(xué)會(huì)IC設(shè)計(jì)公司的團(tuán)隊(duì)分工與合作，相當(dāng)于一年以上的數(shù)字電路設(shè)計(jì)水平和經(jīng)驗(yàn)。

培養(yǎng)對(duì)象

  1.理工科背景，有志于數(shù)字集成電路設(shè)計(jì)工作的學(xué)生和轉(zhuǎn)行人員；
  2.需要充電，提升技術(shù)水平和熟悉設(shè)計(jì)流程的在職人員；
  3.集成電路設(shè)計(jì)企業(yè)的員工內(nèi)訓(xùn)。

入學(xué)要求

學(xué)員學(xué)習(xí)本課程應(yīng)具備下列基礎(chǔ)知識(shí)：
◆電路系統(tǒng)的基本概念。

班級(jí)規(guī)模及環(huán)境--熱線:4008699035 手機(jī):15921673576( 微信同號(hào))

每期人數(shù)限3到5人。

上課時(shí)間和地點(diǎn)

上課地點(diǎn)：【上海】：同濟(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號(hào)線白銀路站) 【深圳分部】：電影大廈(地鐵一號(hào)線大劇院站)/深圳大學(xué)成教院【北京分部】：北京中山學(xué)院/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領(lǐng)館區(qū)1號(hào)（中和大道）【沈陽分部】：沈陽理工大學(xué)/六宅臻品【鄭州分部】：鄭州大學(xué)/錦華大廈【石家莊分部】：河北科技大學(xué)/瑞景大廈【廣州分部】：廣糧大廈【西安分部】：協(xié)同大廈
最近開課時(shí)間(周末班/連續(xù)班/晚班）：數(shù)字集成電路前端：2020年3月16日

實(shí)驗(yàn)設(shè)備

　    ☆資深工程師授課


        ☆注重質(zhì)量
        ☆邊講邊練
        ☆合格學(xué)員免費(fèi)推薦工作

        ☆合格學(xué)員免費(fèi)頒發(fā)相關(guān)工程師等資格證書，提升您的職業(yè)資質(zhì)

        專注高端培訓(xùn)15年，端海提供的證書得到本行業(yè)的廣泛認(rèn)可，學(xué)員的能力
        得到大家的認(rèn)同，受到用人單位的廣泛贊譽(yù)。

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師資團(tuán)隊(duì)

【趙老師】

大規(guī)模集成電路設(shè)計(jì)專家，10多年超大規(guī)模電路SOC芯片設(shè)計(jì)和版圖設(shè)計(jì)經(jīng)驗(yàn)，參與過DSP、GPU、DTV、WIFI、手機(jī)芯片、物聯(lián)網(wǎng)芯片等芯片的研發(fā)。精通CMOS工藝流程、版圖設(shè)計(jì)和布局布線，精通SOC芯片設(shè)計(jì)和版圖設(shè)計(jì)的各種EDA工具（如：DC/Prime Time/Encounter/Virtuoso/Calibre/Dracula/Assura），具有豐富的SOC芯片設(shè)計(jì)、驗(yàn)證、DFT、PD、流片經(jīng)驗(yàn)。
熟練掌握版圖設(shè)計(jì)規(guī)則并進(jìn)行驗(yàn)證及修改；熟練掌握Unix/Linux操作系統(tǒng)；熟悉CMOS設(shè)計(jì)規(guī)則、物理設(shè)計(jì)以及芯片的生產(chǎn)流程與封裝。

【王老師】

資深I(lǐng)C工程師，十幾年集成電路IC設(shè)計(jì)經(jīng)驗(yàn)，精通chip的規(guī)劃、數(shù)字layout、analog layout和特殊電路layout。先后主持和參與了近三百顆CHIP的設(shè)計(jì)與版圖Layout工作,含MCU芯片、DSP芯片、LED芯片、視頻芯片、GPU芯片、通信芯片、LCD芯片、網(wǎng)絡(luò)芯片、手機(jī)芯片等等。
從事過DAC、ADC、RF、OP、PLL、PLA、LNA、ESD、ROM、RAM等多種制程analog&digital的電路IC設(shè)計(jì)，
熟練掌握1.8V，3.3V,5V,18V,25V，40V等各種高低壓混合電路的IC設(shè)計(jì)。

【張老師】

從事數(shù)字集成電路設(shè)計(jì)10余年，精通CMOS工藝流程、版圖設(shè)計(jì)和布局布線，精通VERILOG,VHDL語言，
擅長芯片前端設(shè)計(jì)和復(fù)雜項(xiàng)目實(shí)施的規(guī)劃管理，其領(lǐng)導(dǎo)開發(fā)的芯片已成功應(yīng)用于數(shù)個(gè)國際知名芯片廠商之產(chǎn)品中。豐富的芯片開發(fā)經(jīng)驗(yàn)，對(duì)于現(xiàn)今主流工藝下的同步數(shù)字芯片設(shè)計(jì)技術(shù)和流程有良好把握。長期專注于內(nèi)存控制器等產(chǎn)品的研發(fā)，擁有數(shù)顆規(guī)模超過百萬門的數(shù)字芯片成功流片經(jīng)驗(yàn).

★更多師資力量請(qǐng)見端海師資團(tuán)隊(duì)。

最新優(yōu)惠

◆請(qǐng)咨詢客服。

質(zhì)量保障

        1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費(fèi)在以后培訓(xùn)班中重聽；
        2、培訓(xùn)結(jié)束后,授課老師留給學(xué)員聯(lián)系方式,保障培訓(xùn)效果,免費(fèi)提供課后技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會(huì)。

　　　　　 數(shù)字集成電路前端設(shè)計(jì)培訓(xùn)班

1. Unix/Linux操作系統(tǒng)使用
2. 文本編輯器VIM
3. 數(shù)字電路技術(shù)基礎(chǔ)
4. 半導(dǎo)體電路和工藝基礎(chǔ)
5. 數(shù)字邏輯設(shè)計(jì)
6. 數(shù)字集成電路設(shè)計(jì)流程
7. Verilog HDL硬件描述語言和電路設(shè)計(jì)技術(shù)與技巧
8. 電路驗(yàn)證技術(shù)以及Modelsim、VCS等驗(yàn)證工具的使用
9. ASIC和SOC設(shè)計(jì)導(dǎo)論
10. FPGA設(shè)計(jì)和驗(yàn)證初步
11.數(shù)字電路驗(yàn)證
1)驗(yàn)證平臺(tái)的建立
2）功能測試
12.設(shè)計(jì)綜合（synthesys）
13.掃描鏈生成
14.仿真測試
1）DFT
2)ATPG
15.靜態(tài)時(shí)序分析(STA)
16.項(xiàng)目實(shí)戰(zhàn)：
1）RTL coding
2)狀態(tài)機(jī)中斷處理
3）testbench 建立
4）Testcase創(chuàng)建
17.項(xiàng)目實(shí)戰(zhàn)二：
1）RTL coding
2)通訊數(shù)據(jù)協(xié)議E1
3)異步電路處理
4）算法
5）CPU控制
6）Testbench建立和testcase
7)綜合和DFT
8)STA
18.數(shù)字前端全流程設(shè)計(jì)工具
19.相關(guān)工藝庫文件IC技術(shù)
20. 邏輯綜合初步以及SYNOPSYS DC等綜合工具的使用
21. 可測性設(shè)計(jì)技術(shù)

重點(diǎn)講解數(shù)字電路設(shè)計(jì)的綜合技術(shù)的基本概念，綜合流程和工程經(jīng)驗(yàn)，使學(xué)員掌握基于synopsys DC的綜合技巧。

內(nèi)容包括：

綜合機(jī)理的分析；組合電路和時(shí)序電路實(shí)現(xiàn)規(guī)則和實(shí)例分析；基于tcl綜合的流程,優(yōu)化處理和調(diào)試技術(shù)；綜合處理與后端流程的聯(lián)系；可綜合代碼技術(shù)；需深入研究的內(nèi)容；LPC 接口模塊綜合實(shí)驗(yàn)

ASIC DFT技術(shù)

介紹可測試設(shè)計(jì)技術(shù)，使學(xué)員掌握基于Synopsys DFT 的可測性電路設(shè)計(jì)方法

內(nèi)容包括：

背景分析；組合電路和時(shí)序電路的測試；可測試設(shè)計(jì)；需深入研究的內(nèi)容；DFT compile 使用(基于TCL的可測試性設(shè)計(jì)流程)；LPC接口模塊DFT實(shí)驗(yàn)

ASIC 靜態(tài)時(shí)序分析技術(shù)

介紹靜態(tài)時(shí)序分析技術(shù)；使學(xué)員掌握基于Synopsysy PrimeTime的靜態(tài)時(shí)序分析技術(shù)。

內(nèi)容包括：

背景分析；電路時(shí)序分析的基礎(chǔ)內(nèi)容；工具的使用；靜態(tài)時(shí)序分析模式選擇；注意事項(xiàng)及需深入研究的內(nèi)容；LPC接口模塊實(shí)驗(yàn)

一致性驗(yàn)證（Formal）技術(shù)介紹

介紹一致性驗(yàn)證技術(shù)，使學(xué)員了解基于Synopsys Formality 的一致性驗(yàn)證方法

內(nèi)容包括：

背景分析；工具的使用介紹
22.形式驗(yàn)證技術(shù)。基于Formality的形式驗(yàn)證方法、基于匹配策略的形式驗(yàn)證技術(shù)、基于TCL的形式驗(yàn)證過程。

23、功耗控制技術(shù)。基于PrimePower的功耗分析技術(shù)，基于Power Compiler的時(shí)鐘門控技術(shù)、基于數(shù)字單元庫的功耗分析方法、基于TCL的功耗分析等多種功耗分析方法和時(shí)鐘門控技術(shù)的實(shí)現(xiàn)。

24、LAYOUT設(shè)計(jì)流程。基于ASTRO的芯片Layout技術(shù)及基于SPEF反標(biāo)提取的PostLayout相關(guān)數(shù)字流程，包含在PostLayout中的網(wǎng)表提取、參數(shù)提取、形式驗(yàn)證、靜態(tài)實(shí)現(xiàn)驗(yàn)證、門級(jí)功能仿真、功耗分析，以及Layout驗(yàn)證（DRC、LVS）等技巧。

25、UWB項(xiàng)目開發(fā)過程中的各種電路優(yōu)化手段。

26、UWB項(xiàng)目介紹。立項(xiàng)分析、實(shí)現(xiàn)方案的規(guī)劃。

27、VLSI系統(tǒng)的設(shè)計(jì)方法學(xué)。時(shí)序分析法、基于Snopsys EDA Tools Chain實(shí)現(xiàn)的完整ASIC設(shè)計(jì)流程、數(shù)字設(shè)計(jì)庫的介紹，分析、創(chuàng)建，及使用。

28、編碼及仿真技巧。編碼規(guī)范、RTL驗(yàn)證仿真技術(shù)、門級(jí)仿真技術(shù)。

29、ASIC設(shè)計(jì)流程的高級(jí)話題。例如跨時(shí)鐘域信號(hào)的處理，同步撫慰電路設(shè)計(jì)及相關(guān)流程處理等設(shè)計(jì)技巧。
30. 項(xiàng)目設(shè)計(jì)實(shí)訓(xùn):
大型實(shí)訓(xùn)項(xiàng)目一.Sigma-Delta小數(shù)分頻器設(shè)計(jì)、驗(yàn)證與綜合
大型實(shí)訓(xùn)項(xiàng)目二.DVI編碼器/解碼器設(shè)計(jì)、驗(yàn)證與綜合

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